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V62/24609-01XE

Name: Texas Instruments V62/24609-01XE
Brand: Texas Instruments
SKU: 595-V62/24609-01XE
Price: 16.77 PEN
Availability: InStock

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Mouser N.º:

595-V62/24609-01XE

Fabricante N.º:

V62/24609-01XE

Fabricante:

Texas Instruments

Descripción:

Básculas electrónicas BD9 SPIN EP SN74LV2T 74PWREP

Hoja de datos:

V62/24609-01XE Hoja de datos

Modelo ECAD:

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	S/16.77	S/16.77
	S/11.40	S/114.00
	S/10.54	S/263.50
	S/9.16	S/916.00
	S/8.60	S/2,150.00
	S/7.53	S/3,765.00
	S/6.24	S/6,240.00
	S/5.81	S/17,430.00
	S/5.68	S/34,080.00

.hidden-for-nojs { display: none; } .pull-right-nojs { justify-content: flex-end; }

Atributo del producto	Valor de atributo	Seleccionar atributo
Fabricante:	Texas Instruments
Categoría de producto:	Básculas electrónicas
RoHS:
Familia lógica:	74LV
Número de circuitos:	2 Circuit
Tipo de salida:	Push-Pull
Paquete / Cubierta:	TSSOP-14
Tipo de entrada:	CMOS
Corriente de salida de nivel alto:	- 8 mA
Corriente de salida de nivel bajo:	8 mA
Voltaje de alimentación - Mín.:	1.8 V
Voltaje de alimentación - Máx.:	5.5 V
Estilo de montaje:	SMD/SMT
Temperatura de trabajo mínima:	- 55 C
Temperatura de trabajo máxima:	+ 125 C
Marca:	Texas Instruments
País de ensamblaje:	Not Available
País de difusión:	Not Available
País de origen:	MY
Frecuencia de reloj máxima:	66.2 MHz
Número de líneas de entrada:	8 Input
Número de líneas de salida:	4 Output
Tipo de producto:	Flip Flops
Serie:	SN74LV2T74
Cantidad de empaque de fábrica:	3000
Subcategoría:	Logic ICs

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USHTS:: 8542390090
TARIC:: 8542319000
MXHTS:: 8542399999
ECCN:: EAR99

SN74LV2T74/SN74LV2T74-Q1 Dual D-Type Flip-Flop

Texas Instruments SN74LV2T74/SN74LV2T74-Q1 Dual D-Type Flip-Flops contain two independent D-type positive-edge-triggered flip-flops. A low level at the preset (PRE) input sets the output high. A low level at the clear (CLR) input resets the output low. Preset and clear functions are asynchronous and not dependent on the levels of the other inputs. When PRE and CLR are inactive (high), data at the data (D) input meeting the setup time requirements is transferred to the outputs (Q, Q) on the positive-going edge of the clock (CLK) pulse. Clock triggering occurs at a voltage level and is not directly related to the rise time of the input clock (CLK) signal. Following the hold-time interval, data at the data (D) input can be changed without affecting the levels at the outputs (Q, Q). The output level is referenced to the supply voltage (V_CC) and supports 1.8V, 2.5V, 3.3V, and 5V CMOS levels.